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一个程序的testbench是不是应该写在verilog程序的后面？还是分开来写用软件仿真的时候调用？
一个程序的testbench是不是应该写在verilog程序的后面？还是分开来写用软件仿真的时候调用？
2025-03-22 12:18:42
推荐回答（1个）
回答1：
分开写
testbench里要把你的设计文件例化进去
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