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怎样把几个VHDL程序生成相应的模块然后再将它们组合成一个原理图？在quartus中具体怎么操作？
怎样把几个VHDL程序生成相应的模块然后再将它们组合成一个原理图？在quartus中具体怎么操作？
2025-02-27 07:00:11
推荐回答（1个）
回答1：
写一个顶层文件。在architecture里面声明component后把你上面说的模块组成你想要的电路就行了
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