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verilog中调用模块变量的类型
verilog中调用模块变量的类型
2024-11-29 08:48:35
推荐回答（1个）
回答1：
实例化时用wire类型，C3，C5只能用wire类型。这是规定
你在Test这个module里面实例化FADD，意思就是用 线把FADD的几个信号连起来，这种“线”的作用只是传递信号高低，所以不用reg
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